Latch-based designs have many benefits over their flip-flop based counterparts but have limited use partially because most RTL specifications are flop-centric and automatic conversion of FF to latch-based designs is challenging. Conventional conversion algorithms target master-slave latch-based designs with two non-overlapping clocks. This paper presents a novel automated design flow that converts flip-flop to 3-phase latch-based designs. The resulting circuits have the same performance as the master-slave based designs but require significantly less latches. Our experimental results demonstrate the potential for savings in the number of latches (21.3%), area (5.8%), and power (16.3%) on a variety of ISCAS, CEP, and CPU benchmark circuits, compared to the master-slave conversions.


翻译:基于 Latch 的设计对基于 翻版的对等方有许多好处,但部分用途有限,因为大多数 RTL 的规格都是以Flop 为中心的,而且将FF 自动转换成基于 latch 的设计是具有挑战性的。 常规转换算法的目标是使用两个非重叠时钟的基于总螺旋螺旋螺旋螺旋螺旋螺旋线的设计。 本文展示了一种新型的自动化设计流程,将翻版螺旋桨转换为基于 3 级的关节线设计。 由此形成的电路与基于 总螺旋线的设计具有相同的性能,但需要的拉特螺旋线大大减少。 我们的实验结果表明,相对于总螺旋线转换而言,在各种ISCAS、CEP和CPU基准电路方面,拉特节数(21.3%)、面积(5.8%)和功率(16.3%)方面,有可能节省。

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